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問(wèn)答題

【計(jì)算題】試用VHDL設(shè)計(jì)一個(gè)半加器，要求采用布爾方程描述方法。

答案：

VHDL描述的半加器

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問(wèn)答題

【簡(jiǎn)答題】
已知輸入信號(hào)A和B的波形如圖（a）所示，試畫(huà)出圖（b）、（ c）中兩個(gè)觸發(fā)器Q端的輸出波形，設(shè)觸發(fā)器初態(tài)為

答案：

根據(jù)給定輸入波形和電路圖，可畫(huà)出兩個(gè)觸發(fā)器Q端的輸出波形Q_D、Q_T如圖所示。

問(wèn)答題

【計(jì)算題】在A、B、C三個(gè)輸入信號(hào)中，A的優(yōu)先權(quán)最高，B次之，C最低，它們的輸出分別用Y_A、Y_B、Y_C表示，要求同一時(shí)間內(nèi)只有一個(gè)信號(hào)輸出。如有兩個(gè)或三個(gè)信號(hào)同時(shí)輸入時(shí)，則只有優(yōu)先權(quán)最高的信號(hào)輸出，使用門電路設(shè)計(jì)一個(gè)能實(shí)現(xiàn)此要求的邏輯電路。

答案：

（1）根據(jù)題意可列出真值表。

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