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單項(xiàng)選擇題

IP核在EDA技術(shù)和開發(fā)中占有很重要的地位，提供VHD、L硬件描述語言功能塊，但不涉及實(shí)現(xiàn)該功能模塊的具體電路的IP核為（）。

A、硬件IP
B、固件IP
C、軟件IP
D、都不是

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單項(xiàng)選擇題

在VHD、L語言中，下列對進(jìn)程（PROC、ESS）語句的語句結(jié)構(gòu)及語法規(guī)則的描述中，不正確的是（）

A、PROC、ESS為一無限循環(huán)語句敏感信號發(fā)生更新時啟動進(jìn)程，執(zhí)行完成后，等待下一次進(jìn)程啟動。
B、敏感信號參數(shù)表中，不一定要列出進(jìn)程中使用的所有輸入信號
C、進(jìn)程由說明部分、結(jié)構(gòu)體部分、和敏感信號三部分組成
D、當(dāng)前進(jìn)程中聲明的變量不可用于其他進(jìn)程

單項(xiàng)選擇題

電子系統(tǒng)設(shè)計(jì)優(yōu)化，主要考慮提高資源利用率減少功耗（即面積優(yōu)化）及提高運(yùn)行速度（即速度優(yōu)化），下列方法（）不屬于面積優(yōu)化。

A、流水線設(shè)計(jì)
B、資源共享
C、邏輯優(yōu)化
D、串行化

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