單項(xiàng)選擇題

在VHDL中，語(yǔ)句”FORIIN0TO7LOOP”定義循環(huán)次數(shù)為（）次。

A.8
B.7
C.0
D.1

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單項(xiàng)選擇題

在VHDL的FOR_LOOP語(yǔ)句中的循環(huán)變量是一個(gè)臨時(shí)變量，屬于LOOP語(yǔ)句的局部量，（）事先聲明。

A.必須
B.不必
C.其類(lèi)型要
D.其屬性要

單項(xiàng)選擇題

在VHDL中，可以用語(yǔ)句（）表示檢測(cè)clock下降沿。

A.clock’event
B.clock’eventandclock=’1’
C.clock=’0’
D.clock’eventandclock=’0’

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